thinpad_top.xpr

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<!-- Product Version: Vivado v2019.2 (64-bit)              -->
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      </File>
      <File Path="$PPRDIR/main/core/execute/bru/execute_bru_impl_cond.v">
        <FileInfo>
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          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PPRDIR/main/core/execute/bru/execute_bru_odffs.v">
        <FileInfo>
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      </File>
      <File Path="$PPRDIR/main/core/execute/mem/execute_mem.v">
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      </File>
      <File Path="$PPRDIR/main/core/execute/mem/execute_mem_agu.v">
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      <File Path="$PPRDIR/main/core/execute/mem/execute_mem_dcache_tag.v">
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      <File Path="$PPRDIR/main/core/execute/mem/execute_mem_dmux.v">
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      <File Path="$PPRDIR/main/core/execute/mem/execute_mem_postcmtbuffer.v">
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      <File Path="$PPRDIR/main/core/execute/mem/execute_mem_s1dffs.v">
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      <File Path="$PPRDIR/main/core/execute/mem/execute_mem_storebuffer.v">
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      </File>
      <File Path="$PPRDIR/main/core/execute/mul/execute_mul.v">
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      <File Path="$PPRDIR/main/core/execute/mul/execute_mul_idffs.v">
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      <File Path="$PPRDIR/main/core/execute/mul/execute_mul_sdffs.v">
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      </File>
      <File Path="$PPRDIR/main/core/fetch/fetch_predecode_def.v">
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      </File>
      <File Path="$PPRDIR/main/core/fetch/fetch.v">
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      </File>
      <File Path="$PPRDIR/main/core/fetch/fetch_ctrl2axi.v">
        <FileInfo>
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      </File>
      <File Path="$PPRDIR/main/core/fetch/fetch_ghr.v">
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      </File>
      <File Path="$PPRDIR/main/core/fetch/fetch_ibuffer.v">
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        </FileInfo>
      </File>
      <File Path="$PPRDIR/main/core/fetch/fetch_icache.v">
        <FileInfo>
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        </FileInfo>
      </File>
      <File Path="$PPRDIR/main/core/fetch/fetch_predecode.v">
        <FileInfo>
          <Attr Name="UsedIn" Val="synthesis"/>
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        </FileInfo>
      </File>
      <File Path="$PPRDIR/main/core/fetch/fetch_prediction.v">
        <FileInfo>
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        </FileInfo>
      </File>
      <File Path="$PPRDIR/main/core/fetch/fetch_sequence.v">
        <FileInfo>
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        </FileInfo>
      </File>
      <File Path="$PPRDIR/main/core/fetch/fetch_snooptable.v">
        <FileInfo>
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        </FileInfo>
      </File>
      <File Path="$PPRDIR/main/core/issue/issue.v">
        <FileInfo>
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        </FileInfo>
      </File>
      <File Path="$PPRDIR/main/core/issue/issue_alloc.v">
        <FileInfo>
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        </FileInfo>
      </File>
      <File Path="$PPRDIR/main/core/issue/issue_idffs.v">
        <FileInfo>
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      </File>
      <File Path="$PPRDIR/main/core/issue/issue_pick.v">
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      </File>
      <File Path="$PPRDIR/main/core/issue/issue_pick_core.v">
        <FileInfo>
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        </FileInfo>
      </File>
      <File Path="$PPRDIR/main/core/issue/issue_pick_mux_ctrl.v">
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      </File>
      <File Path="$PPRDIR/main/core/issue/issue_pick_mux_data.v">
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      </File>
      <File Path="$PPRDIR/main/core/issue/issue_queue.v">
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      </File>
      <File Path="$PPRDIR/main/core/issue/issue_wht.v">
        <FileInfo>
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      </File>
      <File Path="$PPRDIR/main/core/misc/misc_vpaddr.v">
        <FileInfo>
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      </File>
      <File Path="$PPRDIR/main/soc/soc.v">
        <FileInfo>
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      </File>
      <File Path="$PPRDIR/main/soc/soc_axi_mmu.v">
        <FileInfo>
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      </File>
      <File Path="$PPRDIR/main/soc/soc_axi_mmu_addrdec.v">
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      </File>
      <File Path="$PPRDIR/main/soc/cops/soc_cops_cordic_sqrt_axi.v">
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      </File>
      <File Path="$PPRDIR/main/soc/soc_reset.v">
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      </File>
      <File Path="$PPRDIR/main/soc/soc_sram_ctrl.v">
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      </File>
      <File Path="$PPRDIR/main/soc/soc_sram_ctrl2axi.v">
        <FileInfo>
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        </FileInfo>
      </File>
      <File Path="$PPRDIR/main/soc/soc_uart_xip_ctrl2axi.v">
        <FileInfo>
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        </FileInfo>
      </File>
      <File Path="$PPRDIR/main/thinpad_top.v">
        <FileInfo>
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      </File>
      <File Path="$PPRDIR/main/amba/axi_constant32.v">
        <FileInfo>
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        </FileInfo>
      </File>
      <File Path="$PPRDIR/main/core/commit/commit_snooptable.v">
        <FileInfo>
          <Attr Name="AutoDisabled" Val="1"/>
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        </FileInfo>
      </File>
      <File Path="$PPRDIR/test/lab3/kernel.coe">
        <FileInfo>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PPRDIR/test/lab1/lab1.coe">
        <FileInfo>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PPRDIR/test/lab2/lab2.coe">
        <FileInfo>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PPRDIR/test/lab3/test_stream/test_stream.coe">
        <FileInfo>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PPRDIR/test/lab3/test/test.coe">
        <FileInfo>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PPRDIR/test/custom/custom.coe">
        <FileInfo>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <Config>
        <Option Name="DesignMode" Val="RTL"/>
        <Option Name="TopModule" Val="thinpad_top"/>
      </Config>
    </FileSet>
    <FileSet Name="constrs_1" Type="Constrs" RelSrcDir="$PSRCDIR/constrs_1">
      <Filter Type="Constrs"/>
      <File Path="$PPRDIR/main/constraints/thinpad_top.xdc">
        <FileInfo>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
        </FileInfo>
      </File>
      <File Path="$PSRCDIR/constrs_1/new/iladebug.xdc">
        <FileInfo>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
        </FileInfo>
      </File>
      <Config>
        <Option Name="TargetConstrsFile" Val="$PSRCDIR/constrs_1/new/iladebug.xdc"/>
        <Option Name="ConstrsType" Val="XDC"/>
      </Config>
    </FileSet>
    <FileSet Name="sim_1" Type="SimulationSrcs" RelSrcDir="$PSRCDIR/sim_1">
      <Filter Type="Srcs"/>
      <File Path="$PPRDIR/test/sim_soc_stage4.v">
        <FileInfo>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PPRDIR/test/sram_model.v">
        <FileInfo>
          <Attr Name="AutoDisabled" Val="1"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PPRDIR/test/sim_soc_stage5.v">
        <FileInfo>
          <Attr Name="AutoDisabled" Val="1"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PPRDIR/test/sim_soc_stage1.v">
        <FileInfo>
          <Attr Name="AutoDisabled" Val="1"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PPRDIR/test/sim_soc_stage2.v">
        <FileInfo>
          <Attr Name="AutoDisabled" Val="1"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PPRDIR/test/sim_soc_stage3.v">
        <FileInfo>
          <Attr Name="AutoDisabled" Val="1"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PPRDIR/sim_soc_stage4_behav.wcfg">
        <FileInfo>
          <Attr Name="UserDisabled" Val="1"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <File Path="$PPRDIR/sim_soc_stage4_behav1.wcfg">
        <FileInfo>
          <Attr Name="UserDisabled" Val="1"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <Config>
        <Option Name="DesignMode" Val="RTL"/>
        <Option Name="TopModule" Val="sim_soc_stage4"/>
        <Option Name="TopLib" Val="xil_defaultlib"/>
        <Option Name="TransportPathDelay" Val="0"/>
        <Option Name="TransportIntDelay" Val="0"/>
        <Option Name="SelectedSimModel" Val="rtl"/>
        <Option Name="SrcSet" Val="sources_1"/>
        <Option Name="XSimWcfgFile" Val="$PPRDIR/sim_soc_stage4_behav.wcfg"/>
        <Option Name="XSimWcfgFile" Val="$PPRDIR/sim_soc_stage4_behav1.wcfg"/>
        <Option Name="NLNetlistMode" Val="funcsim"/>
      </Config>
    </FileSet>
    <FileSet Name="utils_1" Type="Utils" RelSrcDir="$PSRCDIR/utils_1">
      <Filter Type="Utils"/>
      <Config>
        <Option Name="TopAutoSet" Val="TRUE"/>
      </Config>
    </FileSet>
    <FileSet Name="execute_mul_impl_xip" Type="BlockSrcs" RelSrcDir="$PSRCDIR/execute_mul_impl_xip">
      <File Path="$PSRCDIR/sources_1/ip/execute_mul_impl_xip/execute_mul_impl_xip.xci">
        <FileInfo>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <Config>
        <Option Name="TopModule" Val="execute_mul_impl_xip"/>
        <Option Name="UseBlackboxStub" Val="1"/>
      </Config>
    </FileSet>
    <FileSet Name="fetch_axi_register_slice" Type="BlockSrcs" RelSrcDir="$PSRCDIR/fetch_axi_register_slice">
      <File Path="$PSRCDIR/sources_1/ip/fetch_axi_register_slice/fetch_axi_register_slice.xci">
        <FileInfo>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <Config>
        <Option Name="TopModule" Val="fetch_axi_register_slice"/>
        <Option Name="UseBlackboxStub" Val="1"/>
      </Config>
    </FileSet>
    <FileSet Name="commit_axi_register_slice" Type="BlockSrcs" RelSrcDir="$PSRCDIR/commit_axi_register_slice">
      <File Path="$PSRCDIR/sources_1/ip/commit_axi_register_slice/commit_axi_register_slice.xci">
        <FileInfo>
          <Attr Name="AutoDisabled" Val="1"/>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <Config>
        <Option Name="TopModule" Val="commit_axi_register_slice"/>
        <Option Name="UseBlackboxStub" Val="1"/>
      </Config>
    </FileSet>
    <FileSet Name="bram_pht2k" Type="BlockSrcs" RelSrcDir="$PSRCDIR/bram_pht2k">
      <File Path="$PSRCDIR/sources_1/ip/bram_pht2k/bram_pht2k.xci">
        <FileInfo>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <Config>
        <Option Name="TopModule" Val="bram_pht2k"/>
        <Option Name="UseBlackboxStub" Val="1"/>
      </Config>
    </FileSet>
    <FileSet Name="bram_btb2k" Type="BlockSrcs" RelSrcDir="$PSRCDIR/bram_btb2k">
      <File Path="$PSRCDIR/sources_1/ip/bram_btb2k/bram_btb2k.xci">
        <FileInfo>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <Config>
        <Option Name="TopModule" Val="bram_btb2k"/>
        <Option Name="UseBlackboxStub" Val="1"/>
      </Config>
    </FileSet>
    <FileSet Name="bram_icache" Type="BlockSrcs" RelSrcDir="$PSRCDIR/bram_icache">
      <File Path="$PSRCDIR/sources_1/ip/bram_icache/bram_icache.xci">
        <FileInfo>
          <Attr Name="UsedIn" Val="synthesis"/>
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        </FileInfo>
      </File>
      <Config>
        <Option Name="TopModule" Val="bram_icache"/>
        <Option Name="UseBlackboxStub" Val="1"/>
      </Config>
    </FileSet>
    <FileSet Name="bram_dcache_data" Type="BlockSrcs" RelSrcDir="$PSRCDIR/bram_dcache_data">
      <File Path="$PSRCDIR/sources_1/ip/bram_dcache_data/bram_dcache_data.xci">
        <FileInfo>
          <Attr Name="UsedIn" Val="synthesis"/>
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        </FileInfo>
      </File>
      <Config>
        <Option Name="TopModule" Val="bram_dcache_data"/>
        <Option Name="UseBlackboxStub" Val="1"/>
      </Config>
    </FileSet>
    <FileSet Name="sim_bram_dmem" Type="BlockSrcs" RelSrcDir="$PSRCDIR/sim_bram_dmem">
      <File Path="$PSRCDIR/sources_1/ip/sim_bram_dmem/sim_bram_dmem.xci">
        <FileInfo>
          <Attr Name="AutoDisabled" Val="1"/>
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        </FileInfo>
      </File>
      <Config>
        <Option Name="TopModule" Val="sim_bram_dmem"/>
        <Option Name="UseBlackboxStub" Val="1"/>
      </Config>
    </FileSet>
    <FileSet Name="sim_bram_imem" Type="BlockSrcs" RelSrcDir="$PSRCDIR/sim_bram_imem">
      <File Path="$PSRCDIR/sources_1/ip/sim_bram_imem/sim_bram_imem.xci">
        <FileInfo>
          <Attr Name="AutoDisabled" Val="1"/>
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        </FileInfo>
      </File>
      <Config>
        <Option Name="TopModule" Val="sim_bram_imem"/>
        <Option Name="UseBlackboxStub" Val="1"/>
      </Config>
    </FileSet>
    <FileSet Name="soc_periph_clock_converter" Type="BlockSrcs" RelSrcDir="$PSRCDIR/soc_periph_clock_converter">
      <File Path="$PSRCDIR/sources_1/ip/soc_periph_clock_converter/soc_periph_clock_converter.xci">
        <FileInfo>
          <Attr Name="UsedIn" Val="synthesis"/>
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        </FileInfo>
      </File>
      <Config>
        <Option Name="TopModule" Val="soc_periph_clock_converter"/>
        <Option Name="UseBlackboxStub" Val="1"/>
      </Config>
    </FileSet>
    <FileSet Name="soc_cops_cordic_sqrt" Type="BlockSrcs" RelSrcDir="$PSRCDIR/soc_cops_cordic_sqrt">
      <File Path="$PSRCDIR/sources_1/ip/soc_cops_cordic_sqrt/soc_cops_cordic_sqrt.xci">
        <FileInfo>
          <Attr Name="UsedIn" Val="synthesis"/>
          <Attr Name="UsedIn" Val="implementation"/>
          <Attr Name="UsedIn" Val="simulation"/>
        </FileInfo>
      </File>
      <Config>
        <Option Name="TopModule" Val="soc_cops_cordic_sqrt"/>
        <Option Name="UseBlackboxStub" Val="1"/>
      </Config>
    </FileSet>
  </FileSets>
  <Simulators>
    <Simulator Name="XSim">
      <Option Name="Description" Val="Vivado Simulator"/>
      <Option Name="CompiledLib" Val="0"/>
    </Simulator>
    <Simulator Name="ModelSim">
      <Option Name="Description" Val="ModelSim Simulator"/>
    </Simulator>
    <Simulator Name="Questa">
      <Option Name="Description" Val="Questa Advanced Simulator"/>
    </Simulator>
    <Simulator Name="Riviera">
      <Option Name="Description" Val="Riviera-PRO Simulator"/>
    </Simulator>
    <Simulator Name="ActiveHDL">
      <Option Name="Description" Val="Active-HDL Simulator"/>
    </Simulator>
  </Simulators>
  <Runs Version="1" Minor="11">
    <Run Id="synth_1" Type="Ft3:Synth" SrcSet="sources_1" Part="xc7a200tfbg676-2" ConstrsSet="constrs_1" Description="Vivado Synthesis Defaults" AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" State="current" Dir="$PRUNDIR/synth_1" IncludeInArchive="true">
      <Strategy Version="1" Minor="2">
        <StratHandle Name="Vivado Synthesis Defaults" Flow="Vivado Synthesis 2016"/>
        <Step Id="synth_design"/>
      </Strategy>
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      <ReportStrategy Name="Vivado Synthesis Default Reports" Flow="Vivado Synthesis 2017"/>
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    </Run>
    <Run Id="execute_mul_impl_xip_synth_1" Type="Ft3:Synth" SrcSet="execute_mul_impl_xip" Part="xc7a200tfbg676-2" ConstrsSet="execute_mul_impl_xip" Description="Vivado Synthesis Defaults" AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" Dir="$PRUNDIR/execute_mul_impl_xip_synth_1" IncludeInArchive="true">
      <Strategy Version="1" Minor="2">
        <StratHandle Name="Vivado Synthesis Defaults" Flow="Vivado Synthesis 2019"/>
        <Step Id="synth_design"/>
      </Strategy>
      <GeneratedRun Dir="$PRUNDIR" File="gen_run.xml"/>
      <ReportStrategy Name="Vivado Synthesis Default Reports" Flow="Vivado Synthesis 2019"/>
      <Report Name="ROUTE_DESIGN.REPORT_METHODOLOGY" Enabled="1"/>
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    </Run>
    <Run Id="fetch_axi_register_slice_synth_1" Type="Ft3:Synth" SrcSet="fetch_axi_register_slice" Part="xc7a200tfbg676-2" ConstrsSet="fetch_axi_register_slice" Description="Vivado Synthesis Defaults" AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" Dir="$PRUNDIR/fetch_axi_register_slice_synth_1" IncludeInArchive="true">
      <Strategy Version="1" Minor="2">
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        <Step Id="synth_design"/>
      </Strategy>
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    </Run>
    <Run Id="commit_axi_register_slice_synth_1" Type="Ft3:Synth" SrcSet="commit_axi_register_slice" Part="xc7a200tfbg676-2" ConstrsSet="commit_axi_register_slice" Description="Vivado Synthesis Defaults" AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" Dir="$PRUNDIR/commit_axi_register_slice_synth_1" IncludeInArchive="true">
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        <Step Id="synth_design"/>
      </Strategy>
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    </Run>
    <Run Id="bram_pht2k_synth_1" Type="Ft3:Synth" SrcSet="bram_pht2k" Part="xc7a200tfbg676-2" ConstrsSet="bram_pht2k" Description="Vivado Synthesis Defaults" AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" Dir="$PRUNDIR/bram_pht2k_synth_1" IncludeInArchive="true">
      <Strategy Version="1" Minor="2">
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    </Run>
    <Run Id="bram_btb2k_synth_1" Type="Ft3:Synth" SrcSet="bram_btb2k" Part="xc7a200tfbg676-2" ConstrsSet="bram_btb2k" Description="Vivado Synthesis Defaults" AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" Dir="$PRUNDIR/bram_btb2k_synth_1" IncludeInArchive="true">
      <Strategy Version="1" Minor="2">
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      </Strategy>
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    </Run>
    <Run Id="bram_icache_synth_1" Type="Ft3:Synth" SrcSet="bram_icache" Part="xc7a200tfbg676-2" ConstrsSet="bram_icache" Description="Vivado Synthesis Defaults" AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" Dir="$PRUNDIR/bram_icache_synth_1" IncludeInArchive="true">
      <Strategy Version="1" Minor="2">
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      </Strategy>
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    </Run>
    <Run Id="bram_dcache_data_synth_1" Type="Ft3:Synth" SrcSet="bram_dcache_data" Part="xc7a200tfbg676-2" ConstrsSet="bram_dcache_data" Description="Vivado Synthesis Defaults" AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" Dir="$PRUNDIR/bram_dcache_data_synth_1" IncludeInArchive="true">
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      </Strategy>
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    </Run>
    <Run Id="sim_bram_dmem_synth_1" Type="Ft3:Synth" SrcSet="sim_bram_dmem" Part="xc7a200tfbg676-2" ConstrsSet="sim_bram_dmem" Description="Vivado Synthesis Defaults" AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" Dir="$PRUNDIR/sim_bram_dmem_synth_1" IncludeInArchive="true">
      <Strategy Version="1" Minor="2">
        <StratHandle Name="Vivado Synthesis Defaults" Flow="Vivado Synthesis 2019"/>
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      </Strategy>
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    <Run Id="sim_bram_imem_synth_1" Type="Ft3:Synth" SrcSet="sim_bram_imem" Part="xc7a200tfbg676-2" ConstrsSet="sim_bram_imem" Description="Vivado Synthesis Defaults" AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" Dir="$PRUNDIR/sim_bram_imem_synth_1" IncludeInArchive="true">
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      </Strategy>
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    </Run>
    <Run Id="soc_periph_clock_converter_synth_1" Type="Ft3:Synth" SrcSet="soc_periph_clock_converter" Part="xc7a200tfbg676-2" ConstrsSet="soc_periph_clock_converter" Description="Vivado Synthesis Defaults" AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" Dir="$PRUNDIR/soc_periph_clock_converter_synth_1" IncludeInArchive="true">
      <Strategy Version="1" Minor="2">
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      </Strategy>
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      <RQSFiles/>
    </Run>
    <Run Id="soc_cops_cordic_sqrt_synth_1" Type="Ft3:Synth" SrcSet="soc_cops_cordic_sqrt" Part="xc7a200tfbg676-2" ConstrsSet="soc_cops_cordic_sqrt" Description="Vivado Synthesis Defaults" AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" Dir="$PRUNDIR/soc_cops_cordic_sqrt_synth_1" IncludeInArchive="true">
      <Strategy Version="1" Minor="2">
        <StratHandle Name="Vivado Synthesis Defaults" Flow="Vivado Synthesis 2019">
          <Desc>Vivado Synthesis Defaults</Desc>
        </StratHandle>
        <Step Id="synth_design"/>
      </Strategy>
      <GeneratedRun Dir="$PRUNDIR" File="gen_run.xml"/>
      <ReportStrategy Name="Vivado Synthesis Default Reports" Flow="Vivado Synthesis 2019"/>
      <Report Name="ROUTE_DESIGN.REPORT_METHODOLOGY" Enabled="1"/>
      <RQSFiles/>
    </Run>
    <Run Id="impl_1" Type="Ft2:EntireDesign" Part="xc7a200tfbg676-2" ConstrsSet="constrs_1" Description="Default settings for Implementation." AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" State="current" Dir="$PRUNDIR/impl_1" SynthRun="synth_1" IncludeInArchive="true" GenFullBitstream="true">
      <Strategy Version="1" Minor="2">
        <StratHandle Name="Vivado Implementation Defaults" Flow="Vivado Implementation 2016"/>
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        <Step Id="phys_opt_design"/>
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        <Step Id="write_bitstream"/>
      </Strategy>
      <GeneratedRun Dir="$PRUNDIR" File="gen_run.xml"/>
      <ReportStrategy Name="Vivado Implementation Default Reports" Flow="Vivado Implementation 2017"/>
      <Report Name="ROUTE_DESIGN.REPORT_METHODOLOGY" Enabled="1"/>
      <RQSFiles/>
    </Run>
    <Run Id="execute_mul_impl_xip_impl_1" Type="Ft2:EntireDesign" Part="xc7a200tfbg676-2" ConstrsSet="execute_mul_impl_xip" Description="Default settings for Implementation." AutoIncrementalCheckpoint="false" WriteIncrSynthDcp="false" SynthRun="execute_mul_impl_xip_synth_1" IncludeInArchive="false" GenFullBitstream="true">
      <Strategy Version="1" Minor="2">
        <StratHandle Name="Vivado Implementation Defaults" Flow="Vivado Implementation 2019"/>
        <Step Id="init_design"/>
        <Step Id="opt_design"/>
        <Step Id="power_opt_design"/>
        <Step Id="place_design"/>
        <Step Id="post_place_power_opt_design"/>
        <Step Id="phys_opt_design" EnableStepBool="1"/>
        <Step Id="route_design"/>
        <Step Id="post_route_phys_opt_design"/>
        <Step Id="write_bitstream"/>
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